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CKIを含む例文一覧と使い方

該当件数 : 14



例文

This signal stops supplying a system operation clock CKi and a power-source voltage.例文帳に追加

この信号により、システム動作クロックCKi、ならびに電源電圧の供給が停止する。 - 特許庁

To adjust simply and quickly a delay time of a delay clock signal SAE adjusting to frequency variation of an input clock signal CKi.例文帳に追加

入力クロック信号CKiの周波数変化に合わせて遅延クロック信号SAEの遅延時間を簡易かつ迅速に調整する。 - 特許庁

A semiconductor integrated circuit is provided with: a DLL circuit 101a for outputting n pieces of clock signals CKi (i is 1 to n) delayed from a reference signal RCLK by a delay time of i×T; a DCMP circuit 103a; and a buffer insertion circuit 102a provided with n pieces of buffers B1 to B16 corresponding to n pieces of the clock signals CKi.例文帳に追加

基準信号RCLKから遅延時間i×Tだけ遅れたn個のクロック信号CKi(iは1〜n)を出力するDLL回路101aと、DCMP回路103aと、n個のクロック信号CKiに対応したn個のバッファーB1〜B16を備えたバッファー挿入回路102aとを有する。 - 特許庁

As a delay time in the next period of a delay clock signal SAE is set based on the pulse signal PULSE generated based on the trailing edge of the input clock signal CKi, even if a period of the input clock signal CKi is varied, a delay time of the delay clock signal SAE can be varies quickly adjusting its variation.例文帳に追加

入力クロック信号CKiの立ち下がりエッジに基づいて生成したパルス信号PULSEに基づいて、遅延クロック信号SAEの次の周期での遅延時間を設定するため、入力クロック信号CKiの周期が変化しても、その変化に合わせて、遅延クロック信号SAEの遅延時間を迅速に変化させることができる。 - 特許庁

例文

When a write control signal/WE becomes 'L', signals S33, S34 of registers 33, 34 become 'L' in rising and falling timing of the clock signal CKi.例文帳に追加

書込制御信号/WEが“L”になると、クロック信号CKiの立ち下がりと立ち上がりのタイミングで、レジスタ33,34の信号S33,S34が“L”になる。 - 特許庁


例文

A coding address generator 71 for writing generates an address AI2 that changes successively according to a supplied clock CKI for writing and supplies AI2 to a memory core 1.例文帳に追加

書込み用コード化アドレス発生器71は、供給される書込み用クロックCKIに従って順次変化するアドレスAI2を発生し、このAI2をメモリコア1に供給する。 - 特許庁

The variable frequency divider 18 frequency-divides the unit clock CKi by the number Y and outputs a signal having a frequency being n times as large as the frequency fr of the reference clock CKr.例文帳に追加

可変分周器18は、パルス数Yで単位クロックCK_i を分周し、基準クロックCK_r の周波数frのn倍の周波数を持つ信号を出力する。 - 特許庁

A reference clock CKr is frequency-divided into four by a frequency divider 11, a unit clock CKi is frequency-divided into two by a frequency divider 12 and the logical product of the output signals of the frequency dividers 11 and 12 is obtained by an AND gate 13.例文帳に追加

基準クロックCK_r が分周器11で4分周され、単位クロックCK_i が分周器12で2分周され、これらの分周器11,12の出力信号の論理積がANDゲート13で求められる。 - 特許庁

In response to the command, the original clocks are outputted while being decimated and subjected to frequency division at a fixed frequency division ratio through a frequency divider before being outputted as a pixel clock Cki for recording image.例文帳に追加

この指示により、原クロックが間引かれて出力され、この出力を分周器により固定の分周比で分周し、画像記録用の画素クロックCKiとして出力する。 - 特許庁

例文

The signal S50 is inverted by an inverter 80 and supplied, as an inner clock CKI, to a data input part 1, a data processing part 2 and a data output part 3.例文帳に追加

一方、信号S50は、インバータ80で反転され、内部クロックCKIとしてデータ入力部1、データ処理部2及びデータ出力部3に供給される。 - 特許庁

例文

Similarly, data DT is selected in selectors 27, 28, and the selected data DT is held in registers 29, 30 in the rising and falling of the clock signal CKi and is outputted as data DTX to the controlled device through an OR31.例文帳に追加

同様に、セレクタ27,28でデータDTが選択され、選択されたデータDTは、クロック信号CKiの立ち上がりと立ち下がりでレジスタ29,30に保持され、OR31を介して被制御装置に対するデータDTXとして出力される。 - 特許庁

Thereby, an address signal AD is selected in selectors 21, 22, and the selected address signal AD is held in registers 23, 24 in the rising and falling of the clock signal CKi and is outputted as an address signal ADX to a controlled device through an OR25.例文帳に追加

これにより、セレクタ21,22でアドレス信号ADが選択され、選択されたアドレス信号ADは、クロック信号CKiの立ち上がりと立ち下がりでレジスタ23,24に保持され、OR25を介して被制御装置に対するアドレス信号ADXとして出力される。 - 特許庁

In a first inverter circuit INV1, one end of a current path of a second conductive second transistor P1 is connected to the other end of a current path of a first conductive first transistor N1 to which one end of the current path is grounded and a first signal CKI consisting of one of first voltage V1 higher than ground potential is supplied to each gate.例文帳に追加

第1のインバータ回路INV1は、電流通路の一端が接地された第1導電型の第1のトランジスタN1の電流通路の他端に第2の導電型の第2のトランジスタP1の電流通路の一端が接続され、各ゲートに接地電位より高い第1の電圧V1の一方からなる第1の信号CKIが供給される。 - 特許庁

例文

A yeast and cytidine 5'-monophosphate (CMP) are reacted with choline in the presence of the enzyme protein prepared by using the specific DNA fragment, and having activities of choline phosphate cytidylyltransferase (CCT), and an enzyme protein prepared by using a specified DNA fragment different therefrom, and having activities of choline kinase (CKI) to produce the objective CDP-choline.例文帳に追加

特定のDNA断片を使用して調製したコリンホスフェートシチジルトランスフェラーゼ(CCT)活性を有する酵素タンパク質、及びそれとは別の特定のDNA断片を使用して調製したコリンキナーゼ(CKI)活性を有する酵素タンパク質の存在下、酵母菌体、シチジン5′−モノリン酸(CMP)及びコリンを反応させてCDP-コリンを製造する。 - 特許庁

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