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積分増幅器の英語
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英訳・英語 integrating amplifier
「積分増幅器」の部分一致の例文検索結果
該当件数 : 97件
演算増幅器、積分回路、帰還増幅器及び帰還増幅器の制御方法例文帳に追加
OPERATION AMPLIFIER, INTEGRATION CIRCUIT, AND FEEDBACK AMPLIFIER AND ITS CONTROL METHOD - 特許庁
演算増幅器及び積分回路例文帳に追加
OPERATIONAL AMPLIFIER AND INTEGRATING CIRCUIT - 特許庁
積分器および自動利得制御増幅器例文帳に追加
INTEGRATOR AND AUTOMATIC GAIN CONTROL AMPLIFIER - 特許庁
この値を積分器11で積分して演算増幅器3に帰還する。例文帳に追加
The value is integrated by an integrator 11 and returned to an operation amplifier 3. - 特許庁
積分器(6)は、演算増幅器(8)と前記演算増幅器の出力端子と前記演算増幅器の反転入力端子間に接続される複数の演算増幅器用積分スイッチトキャパシタ(7_Ik)からなる。例文帳に追加
The integrator 6 is formed of an arithmetic amplifier 8 and plural integration switched capacitors 71k for an arithmetic amplifier to be connected between the output terminal of the amplifier 8 and the inverse inputting terminal of the amplifier 8. - 特許庁
より少ない演算増幅器で複素2次積分器を実現する。例文帳に追加
To provide a complex second integrator having the smaller number of operational amplifiers. - 特許庁
デルタ‐シグマ変調器において使用される積分器段は、演算増幅器(312)、演算増幅器(312)の出力部と加算ノードとを演算増幅器の入力側で結合する積分コンデンサ(C_I)、および帰還経路を含む。例文帳に追加
An integrator stage for use in a delta-sigma modulator includes an operational amplifier (312), an integration capacitor (C_I) coupling an output of the operational amplifier (312) and a summing node at an input of the operational amplifier, and a feedback path. - 特許庁
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「積分増幅器」の部分一致の例文検索結果
該当件数 : 97件
読み出し回路(20)は、直接注入電荷増幅器(28)、積分器キャパシタ(24)、およびデジタルセンス増幅器を含む。例文帳に追加
The circuit 20 includes a direct injection charge amplifier 28, an integrator capacitor 24 and a digital sense amplifier. - 特許庁
積分器(100)は、演算増幅器(11)と、演算増幅器の反転入力端に接続された第1のフィルタ(12)と、演算増幅器の反転入力端と出力端との間に接続された第2のフィルタ(13)とを備えている。例文帳に追加
The integrator (100) includes an operational amplifier (11), a first filter (12) connected to an inverting input terminal of the operational amplifier, and a second filter (13) connected between the inverting input terminal and an output terminal of the operational amplifier. - 特許庁
また、第二増幅器群114と、第二増幅器群114の増幅器114a,114bを選択して積分回路11への入力を出力する選択器12eと、第二増幅器群114の出力を第一加算器113の出力に加算する第二の加算器115とを設ける。例文帳に追加
Further, there are provided a second amplifier group 114; a selector 12e for selecting amplifiers 114a, 114b of the second amplifier group 114 to output an input to the integration circuit 11; and a second adder 115 for adding an output of the second amplifier group 114 to an output of the first adder 113. - 特許庁
差動増幅器6で、積分器4の出力からオフセット成分を除去する。例文帳に追加
The offset component is removed from the output of the integrator 4 by a differential amplifier 6. - 特許庁
スイッチトキャパシタ(SC)で加算器、作動増幅器、積分器などの回路を構成する。例文帳に追加
In this method, circuits such as adder, differential amplifier and integrator are composed with switched capacitors (SC). - 特許庁
演算増幅器215およびコンデンサC3の積分動作により三角波が発生する。例文帳に追加
Integrating operations of an operational amplifier 215 and the capacitor C3 generate the triangular wave. - 特許庁
演算増幅器39と、コンデンサ40とによって積分回路が構成されている。例文帳に追加
An integration circuit comprises an operational amplifier 39 and a capacitor 40. - 特許庁
積分器および自動利得制御増幅器において、入力信号に対する立ち上り応答時間を速くする。例文帳に追加
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